Synopsys 最近为其 DDR5 和 DDR4 以及使用 5nm 晶圆厂技术的下一代片上系统控制器创建了一个新的物理接口。这将允许 SoC 的创建者利用 5nm 节点获得对 DDR5 和 DDR4 内存的额外支持。Synopsys 目前是该接口的领导者，提供高达 6400 MT/s 的数据传输速率。
Synopsys 使用内部DesignWare IP为芯片开发人员(无论是 SoC、SSD 控制器还是 CPU)提供将物理接口和控制器 IP 安装到 5nm 架构中，并确保所有系统都使用提供的经过验证的 IP 正确处理这是由 Synopsys 创建的。DesignWare IP 结构的先进之处在于它包括一个用于 DDR5 和 DDR4 内存模块的控制器，具有命令调度程序、双通道支持、ECC 内存(可选)、内存协议处理程序和 DFI 5.0 物理接口。它具有 64 个用于读取和写入内存模块的 CAM 条目以及处理低至 8 个时钟周期的各种延迟级别。Synopsys DesignWare IP 使用 Arm AMBA 3.0 APB 接口进行编程。该公司还使用设计和重用计划提供经过硅验证的 DDR5 和 DDR4 物理层。此应用程序支持高达 6400 MT/s 的数据传输速率和内存子系统，在其结构中允许多达四个物理列。物理控制器及其物理控制器支持所有 JEDEC 标准 DDR5 和 DDR4 利用率。
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